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stm32: can: fd: implement bus-off recovery
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0ee7748811
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@ -368,6 +368,7 @@ impl Registers {
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w.set_rfne(0, true); // Rx Fifo 0 New Msg
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w.set_rfne(0, true); // Rx Fifo 0 New Msg
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w.set_rfne(1, true); // Rx Fifo 1 New Msg
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w.set_rfne(1, true); // Rx Fifo 1 New Msg
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w.set_tce(true); // Tx Complete
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w.set_tce(true); // Tx Complete
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w.set_boe(true); // Bus-Off Status Changed
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});
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});
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self.regs.ile().modify(|w| {
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self.regs.ile().modify(|w| {
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w.set_eint0(true); // Interrupt Line 0
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w.set_eint0(true); // Interrupt Line 0
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@ -44,53 +44,51 @@ impl<T: Instance> interrupt::typelevel::Handler<T::IT0Interrupt> for IT0Interrup
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let ir = regs.ir().read();
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let ir = regs.ir().read();
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{
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if ir.tc() {
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if ir.tc() {
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regs.ir().write(|w| w.set_tc(true));
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regs.ir().write(|w| w.set_tc(true));
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}
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}
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if ir.tefn() {
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if ir.tefn() {
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regs.ir().write(|w| w.set_tefn(true));
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regs.ir().write(|w| w.set_tefn(true));
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}
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match &T::state().tx_mode {
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TxMode::NonBuffered(waker) => waker.wake(),
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TxMode::ClassicBuffered(buf) => {
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if !T::registers().tx_queue_is_full() {
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match buf.tx_receiver.try_receive() {
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Ok(frame) => {
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_ = T::registers().write(&frame);
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}
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Err(_) => {}
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}
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}
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}
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TxMode::FdBuffered(buf) => {
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if !T::registers().tx_queue_is_full() {
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match buf.tx_receiver.try_receive() {
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Ok(frame) => {
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_ = T::registers().write(&frame);
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}
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Err(_) => {}
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}
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}
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}
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}
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}
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}
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if ir.ped() || ir.pea() {
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match &T::state().tx_mode {
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regs.ir().write(|w| {
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TxMode::NonBuffered(waker) => waker.wake(),
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w.set_ped(true);
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TxMode::ClassicBuffered(buf) => {
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w.set_pea(true);
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if !T::registers().tx_queue_is_full() {
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});
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match buf.tx_receiver.try_receive() {
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Ok(frame) => {
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_ = T::registers().write(&frame);
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}
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Err(_) => {}
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}
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}
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}
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TxMode::FdBuffered(buf) => {
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if !T::registers().tx_queue_is_full() {
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match buf.tx_receiver.try_receive() {
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||||||
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Ok(frame) => {
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_ = T::registers().write(&frame);
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}
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Err(_) => {}
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}
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}
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}
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}
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}
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if ir.rfn(0) {
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if ir.rfn(0) {
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T::state().rx_mode.on_interrupt::<T>(0);
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T::state().rx_mode.on_interrupt::<T>(0);
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}
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}
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if ir.rfn(1) {
|
if ir.rfn(1) {
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T::state().rx_mode.on_interrupt::<T>(1);
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T::state().rx_mode.on_interrupt::<T>(1);
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||||||
}
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}
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if ir.bo() {
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regs.ir().write(|w| w.set_bo(true));
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if regs.psr().read().bo() {
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// Initiate bus-off recovery sequence by resetting CCCR.INIT
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regs.cccr().modify(|w| w.set_init(false));
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}
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}
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}
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}
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}
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}
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